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答 : XOE（X protocol Offload Engine）X協(xié)議卸載引擎，X為TCP，UDP，ARP，ICMP、IGMP等協(xié)議的組合，XOE通過(guò)將操作系統(tǒng)的內(nèi)核網(wǎng)絡(luò)協(xié)議棧卸載到專用的硬件設(shè)備（FPGA or ASIC），完成提升網(wǎng)絡(luò)吞吐量，降低網(wǎng)絡(luò)處理延時(shí)以及降低CPU資源消耗的目的。

答 : XOE采用了全卸載的模式，即將協(xié)議的完整流程全部卸載到硬件實(shí)現(xiàn)，比如TCP連接的建立與刪除，連接管理以及數(shù)據(jù)擁塞控制等，可以完全不依賴軟件協(xié)議棧的配合，支持TCP，UDP，ICMP，IGMP，ARP等協(xié)議硬件卸載以及MAC，PCS等網(wǎng)絡(luò)底層協(xié)議等。

答 : XOE IPcore相對(duì)于內(nèi)核協(xié)議棧，用戶態(tài)協(xié)議?；蛘咂渌布f(xié)議棧主要有3個(gè)方面的優(yōu)勢(shì)：

1、超低延時(shí)，協(xié)議處理低于20ns。

2、高吞吐量，達(dá)到網(wǎng)絡(luò)線速要求；

3、零CPU資源消耗；

答 : XOE提供非常簡(jiǎn)化的集成接口，主要包括應(yīng)用態(tài)數(shù)據(jù)接口（AXI-Stream），網(wǎng)絡(luò)接口（XGMII or AXI-Stream）以及配置接口（AXI-Lite）。

答 : XOE支持當(dāng)前市面上所有的商用FPGA器件，XOE開發(fā)全部使用verilog HDL，可以在FPGA芯片間無(wú)縫遷移。

答 : XOE IPcore可以無(wú)縫集成到基于AMBA的SOC架構(gòu)，當(dāng)前XOE已經(jīng)在smic和tsmc等多個(gè)工藝平臺(tái)完成流片商用。

答 : IPcore交付模式包括三種：

1、授權(quán)網(wǎng)表交付，客戶可以應(yīng)用在其指定的FPGA芯片型號(hào)上，無(wú)數(shù)量限制；

2、限定網(wǎng)表交付，客戶可以應(yīng)用在其指定的具體某幾塊FPGA芯片上；

3、源碼交付，目前歐億芯部分產(chǎn)品 可以提供源碼交易。

答 : 歐億芯以提供標(biāo)準(zhǔn)化的IPcore交付為主，售后服務(wù)主要以遠(yuǎn)程技術(shù)支持為主，包含郵件，電話以及在線即時(shí)通信工具等。